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Avnet Japan開催Xilinxトレーニング
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ステートマシン記述やFunction文を使用した記述を解説し、システムタスクなどを使用したシミュレーション方法を解説します。
開催時間
| 1日コース（10:00～17:00） |
定員 |
東京会場
8名様
大阪会場
6名様
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受講料 |
無償
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使用ツール
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- ISE Design Suite
- Active-HDL
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参加条件 |
- Verilogの基礎知識のある方（または基礎コース受講済の方）
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コース内容 |
- ステートマシン記述やFunction文を使った記述で回路を作成します。
- システムタスクなどを使用したシミュレーション方法を解説致します。
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開催日 |
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